// ============================================================
// Basic Gates (given)
// ============================================================
module and_gate(input a, b, output y);
assign y = a & b;
endmodule
module or_gate(input a, b, output y);
// write code here for or gate
endmodule
module not_gate(input a, output y);
// write code here for not gate
endmodule
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// XOR Gate
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module xor_gate (
input a, b,
output y
);
wire w1,w2,abar,bbar;
not(abar,a);
not(bbar,b);
and a1(w1,a,bbar);
and a2(w2,b,abar);
or o1(y,w1,w2);
endmodule