// ============================================================
// Basic Gates (given)
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module and_gate(input a, b, output y);
assign y = a & b;
endmodule
module or_gate(input a, b, output y);
// write code here for or gate
endmodule
module not_gate(input a, output y);
// write code here for not gate
endmodule
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// XOR Gate
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module xor_gate (
input a, b,
output y
);
wire c,d,e,f;
not n1(c,b);
not n2(d,a);
and a1(e,a,c);
and a2(f,b,d);
or r1(y,e,f);
endmodule